校準完成后,在進行正式測試前,很重要的一點就是要能夠設置被測件進入環回模式。 雖然調試時也可能會借助芯片廠商提供的工具設置環回,但標準的測試方法還是要基于鏈 路協商和通信進行被測件環回模式的設置。傳統的誤碼儀不具有對于PCle協議理解的功 能,只能盲發訓練序列,這樣的缺點是由于沒有經過正常的鏈路協商,可能會無法把被測件 設置成正確的狀態。現在一些新型的誤碼儀平臺已經集成了PCIe的鏈路協商功能,能夠 真正和被測件進行訓練序列的溝通,除了可以有效地把被測件設置成正確的環回狀態,還可 以和對端被測設備進行預加重和均衡的鏈路溝通。在PCI-E的信號質量測試中需要捕獲多少的數據進行分析?天津PCI-E測試推薦貨源
PCle5.0的鏈路模型及鏈路損耗預算在實際的測試中,為了把被測主板或插卡的PCIe信號從金手指連接器引出,PCI-SIG組織也設計了專門的PCIe5.0測試夾具。PCle5.0的這套夾具與PCle4.0的類似,也是包含了CLB板、CBB板以及專門模擬和調整鏈路損耗的ISI板。主板的發送信號質量測試需要用到對應位寬的CLB板;插卡的發送信號質量測試需要用到CBB板;而在接收容限測試中,由于要進行全鏈路的校準,整套夾具都可能會使用到。21是PCIe5.0的測試夾具組成。上海PCI-E測試價目表使用PCI-E協議分析儀能不能直接告訴我總線上的協議錯誤?
SigTest軟件的算法由PCI-SIG提供,會對信號進行時鐘恢復、均衡以及眼圖、抖 動的分析。由于PCIe4.0的接收機支持多個不同幅度的CTLE均衡,而且DFE的電平也 可以在一定范圍內調整,所以SigTest軟件會遍歷所有的CTLE值并進行DFE的優化,并 根據眼高、眼寬的結果選擇比較好的值。14是SigTest生成的PCIe4.0的信號質量測試 結果。SigTest需要用戶手動設置示波器采樣、通道嵌入、捕獲數據及進行后分析,測試效率 比較低,而且對于不熟練的測試人員還可能由于設置疏忽造成測試結果的不一致,測試項目 也主要限于信號質量與Preset相關的項目。為了提高PCIe測試的效率和測試項目覆蓋 率,有些示波器廠商提供了相應的自動化測試軟件。
PCIe4.0標準在時鐘架構上除了支持傳統的共參考時鐘(Common Refclk,CC)模式以 外,還可以允許芯片支持參考時鐘(Independent Refclk,IR)模式,以提供更多的連接靈 活性。在CC時鐘模式下,主板會給插卡提供一個100MHz的參考時鐘(Refclk),插卡用這 個時鐘作為接收端PLL和CDR電路的參考。這個參考時鐘可以在主機打開擴頻時鐘 (SSC)時控制收發端的時鐘偏差,同時由于有一部分數據線相對于參考時鐘的抖動可以互 相抵消,所以對于參考時鐘的抖動要求可以稍寬松一些PCI-E 3.0及信號完整性測試方法;
隨著數據速率的提高,在發送端對信號高頻進行補償還是不夠,于是PCIe3.0及 之后的標準中又規定在接收端(RX端)還要對信號做均衡(Equalization),從而對線路的損 耗進行進一步的補償。均衡電路的實現難度較大,以前主要用在通信設備的背板或長電纜 傳輸的場合,近些年也逐漸開始在計算機、消費類電子等領域應用,比如USB3.0、SATA 6G、DDR5中也均采用了均衡技術。圖4 .4分別是PCIe3 .0和4 .0標準中對CTLE均衡器 的頻響特性的要求。可以看到,均衡器的強弱也有很多擋可選,在Link Training階段TX 和RX端會協商出一個比較好的組合(參考資料: PCI ExpressR Base Specification 4 .0)。PCI-E測試信號完整性測試解決方案;上海PCI-E測試價目表
PCIE與負載只有時鐘線和數據線,搜索的時候沒有控制管理線,怎么找到的寄存器呢?天津PCI-E測試推薦貨源
在2010年推出PCle3.0標準時,為了避免10Gbps的電信號傳輸帶來的挑戰,PCI-SIG 終把PCle3.0的數據傳輸速率定在8Gbps,并在PCle3.0及之后的標準中把8b/10b編碼 更換為更有效的128b/130b編碼,以提高有效的數據傳輸帶寬。同時,為了保證數據傳輸 密度和直流平衡,還采用了擾碼的方法,即數據傳輸前先和一個多項式進行異或,這樣傳輸 鏈路上的數據就看起來比較有隨機性,可以保證數據的直流平衡并方便接收端的時鐘恢復。 擾碼后的數據到了接收端會再用相同的多項式把數據恢復出來。天津PCI-E測試推薦貨源
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